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命令レベル並列処理 : プロセッサアーキテクチャとコンパイラ

安藤秀樹著. -- コロナ社, 2005. -- (並列処理シリーズ / 萩原宏 [ほか] 編 ; 3). <BB00157368>
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安藤秀樹著. -- コロナ社, 2005. -- (並列処理シリーズ / 萩原宏 [ほか] 編 ; 3). <BB00157368>
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所蔵一覧 1件～1件（全1件）

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No. 巻号 所蔵館 配置場所 請求記号 資料ID 状態 返却予定日 予約
0001 図書館 2階書架 548.29||A 111435228 0件
No. 0001
巻号
所蔵館 図書館
配置場所 2階書架
請求記号 548.29||A
資料ID 111435228
状態
返却予定日
予約 0件
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書誌詳細

標題および責任表示 命令レベル並列処理 : プロセッサアーキテクチャとコンパイラ / 安藤秀樹著
メイレイ レベル ヘイレツ ショリ : プロセッサ アーキテクチャ ト コンパイラ
出版・頒布事項 東京 : コロナ社 , 2005.10
形態事項 ix, 227p ; 22cm
巻号情報
ISBN 4339025836
書誌構造リンク 並列処理シリーズ / 萩原宏 [ほか] 編||ヘイレツ ショリ シリーズ <BN06047705> 3//a
その他の標題 奥付タイトル:Instruction-level parallel processing : Processor architecture and compilers
注記 参考文献: p[212]-223
学情ID BA73659821
本文言語コード 日本語
著者標目リンク 安藤, 秀樹
アンドウ, ヒデキ <>
分類標目 情報工学 NDC8:548.2
分類標目 情報工学 NDC9:548.29
件名標目等 並列処理(コンピュータ)||ヘイレツショリ(コンピュータ)
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